Проектирование устройства сбора данных

БОЛЬШАЯ ЛЕНИНГРАДСКАЯ БИБЛИОТЕКА - РЕФЕРАТЫ - Проектирование устройства сбора данных

Проектирование устройства сбора данных

МИНИСТЕРСТВО СВЯЗИ РОССИЙСКОЙ ФЕДЕРАЦИИ

МОСКОВСКИЙ ТЕХНИЧЕСКИЙ УНИВЕРСИТЕТ СВЯЗИ

И ИНФОРМАТИКИ

К У Р С О В А Я Р А Б О Т А

по теме

“ Проектирование устройства сбора данных “

Студент гр. А19301

Рыбалко С.О.

1 Введение :

Отрасль связи является одной из наиболее перспективных отраслей

народного хозяйства с точки зрения возможностей применения средств цифровой

и микропроцессорной техники. К числу областей возможного применения

микропроцессоров (МП) на предприятиях, учреждениях и в системах связи

наряду с такими признанными направления, как управление системами

коммутации каналов и сообщений, автоматизация проектирования, относятся:

создание автоматизированных систем управления технологическими процессами и

информационно-измерительных систем, обеспечивающих автоматизацию измерений,

контроля исправности аппаратуры и линий, управление, а также расширение

сервисных услуг, предоставляемых абонентам, возможностей оконечных

устройств системы связи и многое другое.

Информационно-измерительные и управляющие цифровые и микропроцессорные

системы предназначены для измерения, сбора, обработки, хранения и

отображения информации с реальных объектов, а также для управления ими. Как

правило, микропроцессорные системы (МПС) содержат МП или микро-ЭВМ и

средства измерения и первичного преобразования информации (датчики), сбора

(коммутации) сигналов датчиков, их первичной обработки, передачи данных на

расстояние, исполнительные органы, средства отображения (дисплеи,

графопостроители, электрические печатающие устройства и др.).

Итак, при проведении измерений параметров каналов связи, либо при приеме

телеметрической информации в ЭВМ зачастую возникает необходимость

обеспечить сбор данных. Следует например, последовательно опрашивая

аналоговые каналы, преобразовывать аналоговые измерительные или

телеметрические сигналы, поступающие по ним, в цифровую форму и помещать их

в ОП (ОЗУ) с целью последующей их обработки и отображения.

2 З А Д А Н И Е

Спроектировать устройство сбора данных (УСД). Имеется F аналоговых

каналов. Необходимо последовательно опрашивая их получаемые из каналов

аналоговые величины с помощью АЦП преобразовывать в Цифровую форму (в

двоичные слова стандартной длины 1 байт - 8 бит) и помещать в

последовательные ячейки некоторой области основной памяти (ОП), начиная с

ячейки, имеющей адрес G.

Цифровая процессорная система, фрагментом которой является

проектируемое УСД, в своем составе имеет ОЗУ емкостью [pic] с форматом

адресного слова 2 байта - 16 бит.

Синхронизация работы процессорного устройства осуществляется от

генератора тактовых импульсов (ГТИ). Частота синхроимпульсов f=500 кГц.

Требуется:

1) Исходя из задания проработать вопрос организации ОЗУ цифровой системы;

2) Реализовать УСД в двух вариантах:

а)в виде процессорного устройства, построенного на принципах схемной

логики, с доведением его до уровня функционально-логической схемы;

б)в виде микропроцессорного устройства, построенного на основе

микропроцессора КР580ВМ80. При реализации УСД на базе микропроцессора

следует текущий номер (адрес) аналогового канала хранить в регистре r.

Микропроцессорное устройство необходимо довести до уровня структурной

схемы, составить программу его функционирования на языке Ассемблера,

составить таблицу размещения программы в ОП, начиная с ячейки с адресом (,

а также составить программу в кодовых комбинациях (на машинном языке);

3)В варианте реализации УСД на базе микропроцессора программу цикла сбора

данных с F аналоговых каналов оформить как прерывающую программу в

предложении, что в состав МПС входит контроллер прерываний КР580ВН69.

4)Оценить быстродействие УСД в обоих вариантах реализации.

Индивидуальное задание:

Пусть F = [pic]; G = [pic]; [pic]=2048[pic]8, r = E; ( = [pic].

3 О Р Г А Н И З А Ц И Я О З У

ОЗУ с требуемой емкостью 2048[pic]8 может быть построено на базе

микросхем полупроводниковых ОЗУ, выпускаемых промышленностью, различными

способами.

Выбор микросхем для реализации ОЗУ может осуществляется исходя из разных

критериев:

- минимизации числа корпусов (аппаратных затрат);

- минимизации потребляемой мощности;

- повышения быстродействия МПС;

- согласования напряжений питания основных функциональных модулей МПС и

др.

Исходя из минимизации аппаратных затрат выберем для реализации ОЗУ УСД

микросхему КР565РУ2А. Она содержит 1к ячеек с разрядностью 1 бит. Для

построения ОЗУ с емкостью 2048[pic]8 требуется 16 таких микросхем,

организованных в 2 линейки (страницы) ,каждая из которых содержит по 8

микросхем (по числу бит в ячейке памяти). Обращение к ячейке, расположенной

в той или иной линейке, обеспечивается с помощью управляющего сигнала ВК -

выбор кристалла. Для простоты примем, что микросхема в любой реализации

имеет всего один вход ВК (по ГОСТ - CS). Тогда при ВК=1 обращение к

кристаллу (микросхеме) в данной линейке ОЗУ будет заблокировано. При ВК=0

обращение разрешается. Для адресации двух линеек требуется адрес из одного

бита (0,1). Так как число линеек в ОЗУ не больше двух, то дешифратор не

требуется. Биты адресов линеек размещаются в старших разрядах заданного

адресного слова.

Шестнадцатиразрядное адресное слово позволяет адресовать максимально

216=65536=64к ячеек памяти. Обычно эти адреса распределяются между ОЗУ, ПЗУ

и УВВ, входящими в состав цифровой системы. Если заданное число ячеек ОЗУ

меньше, то для их адресации может потребоваться адресное слово с меньшим

числом разрядов. В этом случае для адресации ячеек ОЗУ задействуются не все

разряды адресного слова заданной длины (2 байта). Будем считать что в таком

варианте старшие разряды остаются незадействованными, поэтому их содержимое

может быть произвольным, ибо оно игнорируется дешифратором адреса ОЗУ.

Однако при фиксированной разрядности адресного регистра из методических

соображений при программировании процессорного устройства целесообразно

загружать нули в незадействованные разряды адресного слова.

Режим обращение к ОП определяется значением управляющего сигнала

ЧТЕНИЕ/ЗАПИСЬ (ЧТ/ЗП) (по ГОСТ - RD/WR). При ЧТ/ЗП=1 обеспечивается режим

чтения информации из ОП, при ЧТ/ЗП=0 - режим записи в ОП.

Опираясь на выше сказанное построим схему ОЗУ с емкостью 2к х 8

(рис.1).

Организация ОЗУ

Ёмкость ОЗУ: 2к х 8 = 2048 х 8. Требуется организация двух линеек по

восемь микросхем КР565РУ2А .

4 РЕАЛИЗАЦИЯ УСД НА ПРИНЦИПАХ СХЕМНОЙ ЛОГИКИ

1 Общая структурная схема УСД

Как и всякое процессорное устройство, УСД состоит из двух основных

узлов: операционного узла (ОУ) и узла управления (УУ), который представляет

собой микропрограммный автомат (рис.2.). ОУ - это устройство, в котором

непосредственно выполняются операции, реализуемые процессором. Этот узел

преобразует коды (операнды), поступающие на входы Р в те или иные

детерминированные моменты времени, в выходной код (результат), снимаемый с

выходов С. В нашем примере на входы ОУ поступают данные с выхода АЦП,

представленные в виде параллельного двоичного кода, а преобразование,

осуществляемое в ОУ УСД, состоит в приеме этих данных из того или иного

аналогового канала и пересылки их в требуемые ячейки оперативной памяти. ОУ

может включать в себя такие элементы, как регистры или иные модули ЗУ,

счетчики, сумматоры, мультиплексоры, дешифраторы и др., соединенные между

собой каналами связи (обычно физическими линиями), по которым двоичная

информация передается, как правило, в параллельной форме.

УУ в определенной последовательности формирует управляющие сигналы

У1,У2,... и с их помощью координирует работу элементов схемы ОУ,

обеспечивая в ОУ требуемую обработку информации. Под действием каждого из

этих сигналов в элементах ОУ производятся некоторые элементарные действия,

называемые микрооперациями. К числу таких действий относятся: считывание

содержимого какого-нибудь регистра, сдвиг содержимого регистра на один

разряд влево или вправо, запись в регистр результата суммирования

операндов, установка регистра или счетчика в требуемое исходное состояние,

счет, то есть прибавление или вычитание единицы к содержимому счетчика и

т.п.

В каждый тактовый период синхроимпульсов в ОУ может выполнятся одна или

несколько независимых друг от друга микроопераций в различных элементах

схемы. Набор микроопераций, выполняемый в ОУ одновременно (в одном такте),

называется микрокомандой (МК). Среди сигналов У могут быть и такие, которые

вх. (

вых.код

код (

(в ОП)

(из АЦП)(

обл.G

управляют работой устройств, находящихся вне процессора (внешних устройств

- ВУ). К числу таких устройств относятся устройства ввода/вывода информации

(УВВ), модули памяти (ОЗУ, ПЗУ), АЦП, ЦАП и др.

УУ работает под действием команд - двоичных кодов, подаваемых на входы

Z1,Z2,... .На входы Х1,Х2,... УУ поступают осведомительные сигналы, иначе

называемые условиями или признаками, которые формируются в ОУ и влияют на

последующие значения управляющих сигналов У, определяя тем самым

последующие этапы преобразования операндов в зависимости от результатов,

полученных в ОУ при выполнении предыдущей микрокоманды.

2 Структурная схема ОУ

В настоящее время отсутствуют сколько-нибудь общие формальные методы

синтеза операционных устройств. По этой причине составление структурной

схемы производится на основе анализа задания и требует от разработчика

наличия соответствующих навыков и опыта.

Оценим состав оборудования ОУ, обеспечивающий выполнение сформулированных

в задании функций УСД.

Внешними по отношению к ОУ являются следующие элементы:

( АЦП - аналого-цифровой преобразователь, осуществляющий преобразование

аналоговой величины (например напряжения аналогового сигнала), действующего

на его входе на данном отрезке времени, в восьмиразрядный двоичный код на

выходе. В момент завершения акта преобразования АЦП вырабатывает сигнал

ОК=1 на соответствующем выходе. Запуск АЦП производится путем подачи

сигнала запуска на соответствующий вход;

( коммутатор каналов - аналоговый мультиплексор-селектор, который в

зависимости от значения четырехразрядного двоичного адресного слова,

поступающего на его адресные входы, подключает к единственному выходу тот

или иной из тринадцати аналоговых сигналов;

( оперативная память (ОП) - полупроводниковое ОЗУ емкостью 2к х 8,

имеющее рассмотренную выше организацию.

К элементам, входящим в состав ОУ УСД, относятся:

( счетчик СТ21 адреса ячеек ОП - 16-разрядный (в соответствии с заданной

разрядностью адресного слова);

( счетчик СТ22 адреса аналоговых каналов - четырехразрядный (F=14 каналов

имеют номера (адреса) от 0000 до 1101. Всего тринадцать адресов);

( триггер Тфл - флаг АЦП, предназначенный для фиксирования сигнала ОК

(асинхронный RS-триггер с инверсными входами ТТЛ. Тфл необходим для

выработки сигнала Х1 в течение всего периода Т в том случае, когда сигнал

ОК АЦП импульсный, т.е. его длительность ( Т).

Структурная схема ОУ , включающая внешние элементы

процессорного устройства, представлена на рис.3. На схеме

070116

Рис.3

стрелками показаны управляющие сигналы У, поступающие из УУ, и сигналы-

условия X, вырабатываемые ОУ и поступающие в УУ.

3 Словесное описание цикла сбора данных

y1. Цикл сбора данных начинается с того, что в счетчик СТ21 производится

запись первой ячейки области памяти ОП, отведенной для хранения данных.

Очевидно, что в качестве СТ21 удобно использовать такой счетчик, в котором

предусмотрена возможность записи информации, как в параллельный регистр.

Тогда, подав на одни входы триггеров логический ноль (потенциал земли или

корпуса), а на другие - логическую единицу (напряжение источника питания),

можно обеспечить запись требуемого адреса в счетчик в одном такте.

y2. счетчик СТ22 сбрасывается в 0. Тем самым в нём формируется адрес

первого аналогового канала, имеющего нулевой номер.

y3. Производится сброс в 0 триггера Тфл (гашение флага).

y4. Адрес аналогового канала из СТ22 выдается на адресные входы

коммутатора. Коммутатор подключает канал №0 ко входу АЦП.

y5. Производится запуск АЦП и в нём начинается процесс аналого-

цифрового преобразования.

y6. Проверяется содержимое триггера Тфл . По окончанию акта

преобразования АЦП вырабатывает сигнал ОК, устанавливающий Тфл в состояние

1. Пока (Тфл)=0 , устройство пребывает в режиме ожидания окончания акта

преобразования в АЦП. Как только Тфл устанавливается в 1, осуществляется

запись данных с выхода АЦП в требуемую ячейку памяти (ОП).

y7. В СТ22 подготавливается адрес следующей ячейки ОП путем прибавления

единицы к содержимому счетчика (к адресу предыдущей ячейки).

y8. В СТ22 формируется адрес следующего аналогового канала (№1)

путем прибавления единицы к содержимому счетчика.

y9. Проверяется содержимое счетчика СТ22 . Если (СТ22)=0, то

операции 3(8 повторяются. В противном случае происходит завершение цикла

сбора данных (выход из цикла), так как все каналы оказываются опрошены.

4 Синтез управляющего устройства (УУ)

1 Этап абстрактного синтеза

Этот этап также требует от разработчика определенных навыков и опыта. На

этапе абстрактного синтеза осуществляется переход от словесного описания

принципа функционирования автомата формализованному представлению в виде

графа или таблиц.

На основании словесного описания составим в соответствующем порядке

список микроопераций, необходимых для управления ОУ (см. Рис.2):

У1 - разрешение записи начального адреса 01AE16 в СТ21, (СТ21 (

01AE16);

У2 - установка в 0 СТ22 (сброс), (СТ22 ( 0);

У3 - сброс Тфл ,(Тфл ( 0);

У4 - разрешение передачи адреса аналогового канала на коммутатор [комм (

(СТ22)];

У5 - запуск АЦП, (зап. АЦП);

У6 - разрешение записи данных из АЦП в ОП, [ОП ( АЦП];

У7 - увеличение на 1 (СТ21) - приращение счетчика, [инкримент СТ21 (

(СТ21)+1];

У8 - увеличение на 1 (СТ22) - приращение счетчика, [инкримент СТ22 (

(СТ22)+1].

В процессе выполнения цикла сбора данных а ОУ УСД вырабатываются

осведомительные сигналы: сигнал Х1=1 - сигнал ОК и сигнал Х2=1 - завершение

цикла сбора данных. Сигнал Х2 вырабатывается в том случае, когда в СТ22

содержится адрес 0000,[Х2=1, если (СТ22)=0], возникающий в нём после адреса

1010 последнего, одинадцатого канала. Сигнал Х2 может быть сформирован

путем логического умножения (на схеме И) сигналов.

Блок-схема алгоритма функционирования ОУ в микрооперациях

Блок-схема (рис. 4) составляется на основе словесного описания и списка

микроопераций.

Рис.5.

Анализ рис. 4 показывает, что микрооперации У1,У2, а также У3,У4,У5 и

У6,У7,У8 не зависят друг от друга и могут выполняться в одном

такте (каждая группа в соответствующем такте). На основании этого можно

составить блок-схему алгоритма в микрокомандах, обозначив каждую из них

буквой Y (рис.5).

произведем разметку блок схемы рис. 5. Начало и конец блок-

схемы обозначим а0 , что соответствует исходному состоянию управляющего

автомата (УУ). Далее вход каждого блока, следующего за операторными

блоками, которые имеют прямоугольную форму, помечаем символами а1 , а2 ,...

, соответствующими последующим состояниям УУ.

Составление граф - схемы функционирования УУ

Построение графа осуществляется на основе произведенной разметки блок-

схемы алгоритма. Каждому из состояний а0 , а1 ,... управляющего автомата

соответствует узел графа (рис.6). Дугами графа изображаются переходы

автомата из одного состояния в другое. Возле каждой дуги указывается

условие (если оно есть) перехода (Х) и выполняемая на данном тактовом

интервале микрокоманда Y. Переходы синхронного автомата из одного состояния

в другое происходят в тактовые моменты времени под действием

синхроимпульсов и входных сигналов.

2 Этап структурного синтеза УУ

Этот этап выполняется на основе формальных методов и включает в себя:

- расчет требуемого объема памяти УУ;

- выбор способа кодирования возможных состояний автомата;

- выбор типа применяемых логических элементов и триггеров;

- нахождение оптимальной с точки зрения минимизации числа элементов и

связей между ними структуры комбинационного цифрового устройства (КЦУ),

входящего в состав схемы УУ.

Определение требуемого числа триггеров ЗУ устройства

управления и кодирование состояний УУ

Из граф-схемы видно, что управляющий автомат должен иметь N=4 состояний

( а0 ( а3 ). Требуемое число триггеров находим как минимальное k,

удовлетворяющее условию N ( 2k. Имеем kмин = 2. Поскольку каждый из

триггеров обладает двумя устойчивыми состояниями , совокупность двух

триггеров позволяет

зафиксировать максимально 22 = 4 различных состояния. В нашем случае

автомат как раз и должен иметь четыре состояния, для фиксации которых

требуется два триггера. Задавая произвольно

|Состояние |Состояния | | Вид перехода | Входные |

|УУ |триггеров ЗУ | | |сигналы |

| |Q2 Q1 | |Q(t)( Q(t+1) | j(t) k(t) |

|а0 | 0 | | 0 | 0 |

| |0 | |0 |--- |

|а1 | 1 | | 1 | 1 |

| |0 | |0 |--- |

|а2 | 0 | | 0 | — |

| |1 | |1 |1 |

|а3 | 1 | | 1 | — |

| |1 | |1 |0 |

Таблица 1 Таблица 2

различные четыре состояния двух триггеров можно произвести кодирование

состояния автомата, как это сделано в табл.1.

Выбор типа логических элементов и триггеров для реализации УУ

Если к цифровому устройству, реализуемому на микросхемах низкой и

средней степени интеграции, не предъявляются жесткие требования в отношении

быстродействия, потребляемой мощности, габаритов и ширины рабочего

диапазона температур, то выбор, как правило, делается в пользу наиболее

развитой серии микросхем широкого применения К1553, выполненные по

технологии ТТЛ. Предполагается, что проектируемое УСД предназначено для

работы в помещениях с составе стандартной аппаратуры. Поэтому требования в

отношении потребляемой мощности, ширины рабочего диапазона температур и

габаритов не являются жесткими. Кроме того, в соответствии с заданием

частота синхроимпульсов f = 500 кГц, что соответствует длительности

тактового периода Т = 1/f = 2 мкс. В свою очередь среднее время задержки

логического сигнала в базовом элементе И-НЕ этой серии 20 нс, что на два

порядка меньше длительности тактового периода Т. Таким образом,

практически любое цифровое устройство серии К1553 обладает достаточным

быстродействием для использования его в схеме УСД.

Как видно из граф-схемы управляющего автомата, каждое его новое

состояние а(t+1) зависит от предыдущего а(t). Отсюда следует, что для ЗУ

автомата удобно применять такие триггеры, которые в процессе перехода

автомата в новое состояние а(t+1) не изменяют своего состояния а(t), то

есть сигналы Q и Q на выходах триггеров ЗУ изменяются лишь на завершающей

стадии перехода автомата в новое состояние. Из триггеров, входящих в серию

К1553, таким свойством обладает двухступенчатый JK-триггер, который

следовательно, может быть выбран для реализации УУ.

Теперь можно изобразить укрупненную схему УУ для проектируемого УСД

(рис.7). Итак схема УУ содержит КЦУ и ЗУ, состоящее из двух JK-триггеров.

Изобразим характеристическую таблицу JK-триггера, показывающую, какие

сигналы возбуждения триггера следует подавать на выходы J и K, чтобы

обеспечить

переход его из состояния Q(t) в новое состояние Q(t+1) (табл.2). В таблице

2 прочерк в колонках J(t) и K(t) означает безразличное значение сигнала (0

или 1).

в ОУ

из ОУ

Составление таблицы функционирования УУ

На основании имеющихся данных (графа, табл. 1 и табл.2) можно построить

полную таблицу функционирования УУ (табл. 3).

Первые восемь колонок табл. 3 получены на основании анализа графа

(рис.6) и табл.1. Связь между колонками 3(12 определяются из табл.2, а

связь между колонками 3(8 и 13(15 получены на основе анализа графа.

Синтез КЦУ

Как видно из рис.7, входными переменными КЦУ являются Х1, Х2,Q1(t) и

Q2(t), представленные в первых колонках таблицы 3. Функциями, формируемыми

на выходах КЦУ, являются сигналы возбуждения триггеров (J и K)и выходные

сигналы Y, соответствующие микрокомандам Y. Эти функции представлены в 9(15

колонках. Таким образом часть табл. 3 представляет собой таблицу истинности

неполно заданных ФАЛ, формируемых на выходах КЦУ. Таблицы истинности

представлены в сокращенной форме. Здесь учтено то обстоятельство, что

переменные Х1 и Х2 поступают на входу КЦУ в разные тактовые моменты времени

и кроме того ни одна из функций не зависит сразу от обеих этих переменных.

Это позволило объединить в первых четырех строках табл. 3 наборы

аргументов, в которых Х1 И Х2, где они есть, принимают значения 0, а в

строках 5(8 наборы, в которых Х1 и Х2 равны 1. Первые два, пятый и шестой

наборы в табл. 3 не содержат переменных Х1 и Х2, то есть значения функций

на этих наборах не зависят от значений Х1 и Х2, поэтому соответствующие

значения выходных функций повторяются дважды: в группе наборов, относящихся

к значениям Х1 и Х2, равным 0 (строки 1(2), а затем в группе наборов, в

которых Х1 и Х2 равны 1 (строки 5(6).

|№ |Условие |Предыдущее |Следующее |Сигналы |Выполняемая |

|п/п|перехода |состояние |состояние |возбуждения |МК |

| | |аi(t) , Q |аi(t+1), |триггеров | |

| | |i(t) |Q i(t+1) | | |

| |Х2 |Х1 |а i|Q2 |Q1 |аi |Q2 |Q1 |J2|K2|J1|K1|Y1 |Y2 |Y3 |

|1 |— |— |а0 |0 |0 |а1 |0 |1 |0 |- |1 |- |1 |0 |0 |

|2 |— |— |а1 |0 |1 |а2 |1 |0 |1 |- |- |1 |0 |1 |0 |

|3 |— |0 |а2 |1 |0 |а2 |1 |0 |- |0 |0 |- |0 |0 |0 |

|4 |0 |— |а3 |1 |1 |а1 |0 |1 |- |1 |- |0 |0 |0 |0 |